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定制未來(lái)，共建生態(tài)，米爾出席安路研討會(huì)

定制未來(lái)，共建生態(tài)，米爾出席安路研討會(huì)

在數(shù)字化浪潮席卷全球的今天，F(xiàn)PGA技術(shù)正成為驅(qū)動(dòng)創(chuàng)新的核心引擎。2025年11月12日，米爾出席安路科技2025 AEC FPGA技術(shù)沙龍·北京專場(chǎng)，與技術(shù)專家及行業(yè)伙伴齊聚一堂，探討前沿技術(shù)趨勢(shì)，解鎖場(chǎng)景化定制方案，共建開(kāi)放共贏的FPGA新生態(tài)! 圖：米爾活動(dòng)現(xiàn)場(chǎng) 論壇上，米爾電子產(chǎn)品經(jīng)理Je... （來(lái)源：新聞?lì)l道）

米爾FPGA 2025-11-13 16:02

米爾與安路聯(lián)合亮相VisionChina 2025，共推FPGA視覺(jué)方案

米爾與安路聯(lián)合亮相VisionChina 2025，共推FPGA視覺(jué)方案

2025年10月28日，由機(jī)器視覺(jué)產(chǎn)業(yè)聯(lián)盟主辦的“2025深圳機(jī)器視覺(jué)展暨機(jī)器視覺(jué)技術(shù)及工業(yè)應(yīng)用研討會(huì)（Vision China）”在深圳國(guó)際會(huì)展中心（寶安）9號(hào)館隆重啟幕。展會(huì)以“VISION+AI賦能電子制造升級(jí)”為主題，聚焦人工智能與機(jī)器視覺(jué)技術(shù)在電子制造全產(chǎn)業(yè)鏈中的融合與創(chuàng)新，集中展示... （來(lái)源：新聞?lì)l道）

米爾安路FPGA視覺(jué) 2025-10-30 16:10

萬(wàn)馬齊奔智算芯片推動(dòng)硅IP與芯片設(shè)計(jì)協(xié)同方法快速演進(jìn)

萬(wàn)馬齊奔智算芯片推動(dòng)硅IP與芯片設(shè)計(jì)協(xié)同方法快速演進(jìn)

作者：SmartDV Technologies全球銷售總監(jiān)Mohith Haridoss 隨著人工智能（AI）大模型的快速發(fā)展以及邊緣智能（Edge AI）的廣泛興起，越來(lái)越多的高性能并行處理器（如GPU）和更多的邊緣和端側(cè)AI系統(tǒng)級(jí)芯片（AI SoC）在市場(chǎng)上不斷攻城掠地；與此同時(shí)，除了傳統(tǒng)的處理器和MCU企業(yè)轉(zhuǎn)向智能智算芯片，... （來(lái)源：技術(shù)文章頻道）

智算芯片AI人工智能 2025-6-16 16:17

國(guó)產(chǎn)FPGA賦能汽車智能化易靈思攜16nm鈦金系列FPGA亮相上海車展

國(guó)產(chǎn)FPGA賦能汽車智能化易靈思攜16nm鈦金系列FPGA亮相上海車展

4月23日至5月2日，第二十一屆上海國(guó)際汽車工業(yè)展覽會(huì)在國(guó)家會(huì)展中心（上海）盛大舉行。國(guó)產(chǎn)FPGA芯片創(chuàng)新型企業(yè)易靈思（展位號(hào)：2BC104）攜多款基于16nm鈦金系列FPGA研發(fā)的汽車電子解決方案重磅亮相，為汽車智能化發(fā)展注入強(qiáng)勁動(dòng)能。本次車展上，易靈思重點(diǎn)展示了Ti60和Ti180兩款16nm FPGA芯片。這些... （來(lái)源：新聞?lì)l道）

FPGA汽車易靈思上海車展 2025-4-27 09:10

喜訊！米爾電子與安路科技達(dá)成IDH生態(tài)戰(zhàn)略合作，共筑FPGA創(chuàng)新生態(tài)

喜訊！米爾電子與安路科技達(dá)成IDH生態(tài)戰(zhàn)略合作，共筑FPGA創(chuàng)新生態(tài)

以芯為基，智創(chuàng)未來(lái)。近日，領(lǐng)先的嵌入式模組廠商-米爾電子正式與國(guó)產(chǎn)FPGA企業(yè)‌安路科技達(dá)成IDH生態(tài)戰(zhàn)略合作‌。雙方將圍繞安路科技飛龍SALDRAGON系列高性能FPSoC，聯(lián)合開(kāi)發(fā)核心板、開(kāi)發(fā)板及行業(yè)解決方案，助力開(kāi)發(fā)者開(kāi)發(fā)成功，加速工業(yè)控制、邊緣智能、汽車電子等領(lǐng)域的創(chuàng)新應(yīng)用落地‌。... （來(lái)源：新聞?lì)l道）

米爾電子安路科技FPGA核心板FPGA開(kāi)發(fā)板安路飛龍派 2025-4-25 15:50

實(shí)際案例說(shuō)明用基于FPGA的原型來(lái)測(cè)試、驗(yàn)證和確認(rèn)IP——如何做到魚與熊掌兼得？

實(shí)際案例說(shuō)明用基于FPGA的原型來(lái)測(cè)試、驗(yàn)證和確認(rèn)IP——如何做到魚與熊掌兼得？

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用硅知識(shí)產(chǎn)權(quán)（IP）內(nèi)核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。全文從介紹使用... （來(lái)源：新聞?lì)l道）

FPGA數(shù)字芯片設(shè)計(jì) 2024-10-28 15:45

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即I... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn) ASIC IP FPGA 2024-8-30 10:35

將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿挑戰(zhàn)的任務(wù)！

將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿挑戰(zhàn)的任務(wù)！

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享（第三部分）：將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿挑戰(zhàn)的任務(wù)！作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì) ASIC IP FPGA 2024-8-26 11:52

將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿挑戰(zhàn)的任務(wù)!

將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿挑戰(zhàn)的任務(wù)!

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享：將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿挑戰(zhàn)的任務(wù)! 作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì)ASIC IPFPGA 2024-8-1 10:20

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享：將ASIC IP核移植到FPGA上——明了需求和詳細(xì)規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享：將ASIC IP核移植到FPGA上——明了需求和詳細(xì)規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本文從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即IP核的必... （來(lái)源：新聞?lì)l道）

ASIC IP核移植到FPGA數(shù)字芯片設(shè)計(jì) 2024-7-26 10:32

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